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title: "선을 가늘게 만들었는데, 왜 신호는 늦게 도착할까"
author: "브레이브브라우저쓰자"
published_at: "2026-10-02T03:00:02.350Z"
updated_at: "2026-09-30T05:42:40.894Z"
tags: ["반도체","반도체 이론","공학","기술 해설","칩 공장"]
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# 선을 가늘게 만들었는데, 왜 신호는 늦게 도착할까

[원문](https://ariser.io/@writer_a9817d5a8de0/%EC%84%A0%EC%9D%84-%EA%B0%80%EB%8A%98%EA%B2%8C-%EB%A7%8C%EB%93%A4%EC%97%88%EB%8A%94%EB%8D%B0-%EC%99%9C-%EC%8B%A0%ED%98%B8%EB%8A%94-%EB%8A%A6%EA%B2%8C-%EB%8F%84%EC%B0%A9%ED%95%A0%EA%B9%8C)

## 배선은 그냥 통과하는 길이 아니다

긴 복도에 사람을 더 많이 밀어 넣으면 끝에 있는 사람도 즉시 움직일까. 칩의 배선을 이해할 때도 ‘전기가 통하니까 곧바로 전달된다’는 직관을 잠깐 내려놓아야 한다. 다음 회로가 1이라고 읽으려면 배선 끝의 전압이 충분히 올라가야 한다. 그 과정에는 주변과 마주한 도체를 충전하는 시간이 든다.

배선에는 전류 흐름을 방해하는 저항 R과, 전하를 저장하는 정전용량 C가 있다. 별도 커패시터를 그려 넣지 않아도, 금속선과 주변 도체 사이의 절연체가 정전용량을 만든다. 신호가 느려지는 이유를 전자 한 개가 선 끝까지 여행하는 시간으로만 설명하면 이 충전 과정을 놓친다.

## 가늘수록 저항은 커지고, 길수록 충전할 곳이 늘어난다

단면이 직사각형인 균일한 금속선을 먼저 생각해보자.

```text
R = ρL/(w·h)
```

ρ는 비저항, L은 길이, w는 폭, h는 두께다. 재료와 길이, 두께가 같을 때 폭을 절반으로 줄이면 저항은 두 배다. 폭과 두께를 모두 절반으로 줄이면 네 배다. 이는 ρ가 일정하다는 비교다. 매우 작은 배선에서는 표면 등에서의 전자 산란과 실제 전도 단면을 줄이는 주변 재료 때문에, 벌크 금속의 비저항만 넣은 예상보다 저항이 나빠질 수 있다. [Stanford 연구진, Kapur 외, 2002](https://web.stanford.edu/class/ee311/NOTES/Kapur2.pdf)

정전용량은 ‘선이 가늘어졌으니 무조건 감소’라고 말하기 어렵다. 아래층과 마주보는 면적뿐 아니라 양옆 선과의 간격, 두께, 절연체의 유전율도 관여한다. 폭을 줄이는 동시에 선 사이를 더 촘촘히 붙이면 측면 결합이 커질 수 있다. 따라서 배선의 속도는 저항 하나만 보고 결정할 수 없다.

## 길이가 두 배면 왜 지연은 네 배가 될까

긴 배선의 저항과 정전용량은 맨 끝에 한 덩어리로 몰려 있지 않다. 선을 따라 조금씩 분포한다. 앞쪽 저항을 통과한 전류가 뒤쪽의 여러 정전용량을 충전해야 하므로, 길이가 늘면 이동 경로와 충전 부담이 함께 커진다.

균일한 분포 RC 선에서 입력을 이상적인 계단 전압으로 바꾸고, 구동기 저항과 끝의 추가 부하를 무시하면 끝 전압이 최종값의 50%에 도달하는 시간은 다음과 같다.

```text
t₅₀ ≈ 0.38·r·c·L²
```

r은 단위길이당 저항, c는 단위길이당 정전용량, L은 선 길이다. 같은 단면과 간격을 유지해 r과 c가 같다면 길이 두 배는 약 네 배의 지연을 뜻한다. IBM의 Vasant Rao가 분석한 분포 RC 선도 이 무부하 조건에서 50% 도달 시간을 총 R과 총 C의 곱에 약 0.379를 곱한 값으로 제시한다. [Rao, 원논문 Table 2](https://www.cecs.uci.edu/~papers/compendium94-03/papers/1995/dac95/pdffiles/21_3.pdf#page=5)

여기서 0.38은 모든 회로의 상수가 아니다. 도달 기준을 90%로 바꾸거나 끝에 큰 부하를 붙이면 값이 달라진다. 실제 구동기의 저항도 추가된다. 인덕턴스와 파동 전파가 중요한 배선에는 RC만의 모델로 충분하지 않다. 길이 제곱 법칙은 조건을 명시한 모델의 결과다.

## 중계기를 세우면, 전력 계산서도 생긴다

해법 하나는 긴 선 중간에 버퍼를 넣어 신호를 다시 구동하는 것이다. 이상적으로 선을 같은 길이의 두 구간으로 나누면 각 구간의 배선 지연은 원래의 4분의 1이 된다. 두 구간을 합쳐도 절반이다. 다만 실제로는 버퍼 자체의 지연과 입력 정전용량을 더해야 한다. 버퍼가 많을수록 무조건 빠르지는 않다.

적절한 간격의 반복 버퍼는 긴 배선의 지연이 길이 제곱으로 불어나는 부담을 완화한다. 그 대신 소자 면적과 소비전력이 늘어난다. 선을 넓히거나 간격을 벌리는 방법도 배치 공간을 요구한다. Stanford 연구는 이런 중계기의 이점과 전력·면적 비용을 함께 분석한다. [Kapur 외, II·IV절](https://web.stanford.edu/class/ee311/NOTES/Kapur2.pdf)

그래서 ‘작은 공정이면 모든 연결도 빨라진다’는 결론은 성립하지 않는다. 가까운 회로 사이의 선은 짧아질 수 있지만, 멀리 떨어진 기능 블록을 잇는 선까지 같은 비율로 짧아지는 것은 아니다. 칩 성능을 높이는 일에는 더 빠른 스위치뿐 아니라, 연결해야 할 거리를 줄이고 어느 길에 공간과 전력을 쓸지 정하는 작업이 포함된다.